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VHDL 逻辑综合 封面

VHDL 逻辑综合

VHDL for logic synthesis

Andrew Rushton · 初版 1995 年

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……和 Hanna - Ricardo Jasinski 写的《Effective Coding with VHDL: Principles and Best Practices》（我正在用这本书理清在 VHDL 中实现各种功能的途径，并在代码中落实最佳实践。） - Andrew Rushton 写的《VHDL for Logic Synthesis》 - Pong Chu 写的《FPGA Prototyping by VHDL Examples: Xilinx MicroBlaze MCS SoC》

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……出于好意，并不是想吵架…… --- 你的代码里有些小问题，表明你可能习惯用 verilog/SV，而不是个有经验的 VHDL 老手。请去读读 Andrew Rushton 的《VHDL for Logic Synthesis》。我也建议你去了解一下 VHDL 的 9 值逻辑（9-valued logic），为什么会这样设计，以及它和 verilog 的 Bit 有何不同。

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数据整理自 Hacker News 公开评论，数据来源 hackerbooks.org 与 Open Library。